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直接数字频率合成(DDS)技术,被广泛应用于现代电子系统及设备的频率源设计中.将DDS设计下载到FPGA中,将使系统更为可靠.应用中如何利用有限的FPGA硬件资源,得到高速、高质的DDS是经常要面对的问题.在直接数字频率合成(DDS)设计中利用波形压缩节省FPGA资源.硬件测试证明,该方法可行并完全达到设计要求. 相似文献
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为提高无线电定高引信性能,将高速数字信号处理器(DSP)、复杂可编程器件(CPLD)、可编程门阵列(FPGA)和直接数字频率合成(DDS)等,应用于引信的时序产生、控制和信号处理电路。在不同空域采用变换时序和发射脉冲宽度的方法,可同时保证引信的灵敏度和相对精度。特别是在超低空时,充分利用微波泄漏信号和DSP的数字信号处理功能,能使定高引信在发射脉宽相同的情况下,获得更好的定高精度和超低空特性,并具有实时适应性和智能性。 相似文献
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介绍了直接数字合成(DDS)技术在锁相频率合成器中的应用,分析了相位舍位的影响,帮助设计者分辨输出频谱中分别由相位舍位和幅度量化所带来的杂波频率 相似文献
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论文针对传统的锁相环(PLL)频率合成方式和直接数字合成(DDS)方式的各自结构原理与优点来进行比较,指出他们的主要难点是在应用中实现宽频带、高分辩率及快速换频的性能,从而提出一种新型的宽频带、换频快、分辨力高的DDS与PLL相结合(DDS&PLL)的频率合成方案,它能在2~30MHz的频率范围内以不大于2ms的时间实现最小间隔为10Hz的换频. 相似文献
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介绍了数字频率合成器(DDS)的基本工作原理,分析了DDS杂散噪声来源及其抑制方法,并给出了一个基于DDS器件AD9852的跳频频率合成器设计方案。 相似文献
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介绍了基于ALTERA公司FPGA器件的高速实时FFT运算单元实现及频率域脉冲压缩处理的设计方法.在分析了基8、按频率抽取FFT算法的基础上,采用多级同步流水线结构,利用现场可编程门阵列(FPGA)完成了最大4096点块浮点FFT.整个设计划分成多个功能模块,采用VHDL描述语言,并在Stratix器件上实现.结果表明,利用FPGA实现复杂的数字信号处理(DSP)算法是完全可行的. 相似文献
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根据SpaceWire总线的组成结构以及采用的数据-滤波编解码技术,针对SpaceWire节点需要与主机设备、SpaceWire接口设备进行异步交互的特点,文章给出了一种SpaceWire节点的高效实现方案。首先,该方案在硬件设计中采用了SpaceWire节点的多时钟域设计,使得节点整体性能得以显著提升;第二,采用双倍数据速率寄存器设计来降低SpaceWire节点发送端设计难度,解决了高速数据发送问题;第三,采用手动布局接收端的底层器件来满足时序要求,解决了高速数据接收问题;第四,计算出接收端RX FIFO的理论读出时钟频率指导硬件程序设计。在此基础上,采用SpaceWire节点的点对点数据传输实验对文章设计验证,结果表明文章给出的方案可以工作在240MHz时钟频率下,满足空间高速数据传输中高可靠性、低误码率和低复杂度的要求。 相似文献
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软硬件划分是SoC软硬件协同设计中的重要步骤之一。针对软硬件划分问题,提出一种基于无向图的软硬件划分方法,将软件成本和硬件成本设定为网络图的节点,将功能模块间的通讯成本设定为无向的边,从而将芯片的软硬件划分问题归结为基于无向图理论的多目标优化求解的问题。仿真结果证明,该方法在算法效率上优于GA算法和KL算法。并且设计研制了FPGA测试平台,实现软硬件并行开发,提高了基带芯片开发的效率。以BDS/GPS双模基带芯片为例,对本方法进行了具体实施,为基带芯片的软硬件划分设计提供了理论依据。 相似文献
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