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基于DSP和FPGA的视频编码器协同设计与算法优化实现 总被引:1,自引:0,他引:1
采用DSP和FPGA协同技术设计实现了一个高性能的MPEG-4视频编码器。FPGA模块完成视频采集、YUV分离、数据I/O等功能,而使用DSP专一进行视频压缩编码。针对DSP片内资源特点设计了片内存储器数据分配方案,并根据该方案优化了MPEG-4视频压缩的数据流模式。提出了基于宏块空间复杂度的宏块类型判断算法,有效地降低了视频压缩算法的计算复杂度。测试结果表明,采用MPEG-4视频标准该视频编码器每秒能够压缩39.2帧CIF图像。 相似文献
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针对宽转速范围开关磁阻ISG 的起动转矩平稳性差和发电性能不理想, 提出用TMS302C31 和CPLD 协调工作以改善开关磁阻ISG 性能的控制思路, 给出了起动和发电状态详细的CPLD 时序控制逻辑仿真图、绕组相电流波形仿真图和原理样机实测波形图; 讨论了I SG 在典型状态的DSP 的控制策略框图, 试验结果表明, 发电状态在4 倍负载突加、2 倍突卸条件下, 其稳态和瞬态性能仍满足MIL-STD-704E 标准。 相似文献
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主要介绍了DSP TMS320VC5402芯片并行引导装载的实现方案。对硬件电路设计和配置文件编写过程中的要点作了讨论,并给出了实例。 相似文献
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