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11.
提出了以微步距硬件插补为核心的三维激光切割数控系统构架,分析了软件任务并构建了控制功能的实时调度模型,实现了Windows平台的实时性及多任务协调控制。开发了基于DDA精插补的微步距硬件插补模块,满足运动控制的速度与精度要求;构建了内核驱动模块实现中断响应与伺服控制;结合空间圆弧转接理论与前推–回溯算法开发了轨迹速度预测与平滑模块;提出了硬件分频调节法实现进给倍率的改变。该三维激光切割数控系统能够实现高速高精度运动控制,并且软硬件结合的开放式结构提高了系统的实时性以及功能的可扩展性。 相似文献
12.
在红外目标识别领域,基于卷积神经网络的深度学习算法的识别精度已远远超过了传统模式识别算法,但神经网络的实现需要庞大的计算和存储,难以在无人机等嵌入式平台上进行部署。针对此问题,将通道级量化策略和梯度的近似优化训练引入到了低比特神经网络模型的建立中,并提出了一种可充分利用硬件计算资源的FPGA加速器,其整体平均性能为65.6GOPS。与其他相关工作的对比表明,低比特量化方法及其FPGA加速器实现,可以为嵌入式红外目标识别系统提供一种能效高、识别精度高的解决方案。 相似文献
13.
14.
MHD加速器模式磁控进气道的优化设计 总被引:3,自引:1,他引:3
为提高超燃冲压发动机进气道在非设计状态下的性能,对磁控进气道进行了研究。采用二维磁流体动力学(MHD)模型对加速器模式的磁控进气道进行了数值模拟和参数优化。分析了电磁作用使空气流率增加的原因,选取了一组优化的设计参数进行数值模拟,确定了磁流体关键参数与进气道主要性能参数的匹配原则。分析表明磁场的大小和方向以及电磁作用的位置对进气道性能有重要影响;唇口附近及上方的电磁作用对增加空气流率起到了关键的作用,磁流体加速器可以显著增加进气道的空气捕获率和压缩比,但由于不可逆效应总压恢复系数会减小。研究结果表明,当飞行马赫数小于设计马赫数时加速器模式的磁控进气道可以提高进气道的性能。 相似文献
15.
为了在X射线脉冲星地面实验系统仿真源模拟产生X射线的基础上,能够快速稳定地得到脉冲轮廓,采用硬件历元叠加的方法获得脉冲轮廓。研究了用硬件实现历元叠加及其数据整合的算法,该算法首先在MATLAB现场可编程逻辑阵列(FPGA)中实现,再通过MATLAB硬件描述语言(HDL)代码生成模块把算法转换成HDL,经编译后获得配置硬件的Bit文件,最终在开发板FPGA上实现数据处理的硬件模块。一段时间内的光子到达时间数据通过MATLAB算法得到的脉冲轮廓数据与通过硬件模块处理后得到的数据结果存在误差,在单个时间窗口内误差最大值为2个光子数,误差平均值占光子数统计平均值的0.084%;两组统计的脉冲轮廓数据中不同数据占总数据个数的9.481%,这样的误差不影响后端模拟导航模块的导航。利用硬件实现的历元叠加及其数据整合模块具有处理速度快、设备紧凑、功耗低的特点,为航天器利用X射线脉冲星导航提供了一种可行的硬件数据处理技术上的支持。 相似文献
16.
17.
航空发动机闭环控制系统的设计过程复杂且环节繁多,如果通过某平台综合多个设计过程,必然可以简化流程,提高效率.在总结国内外相关文献的基础上,针对民用涡扇发动机,在Matlab/Simulink下,利用模块化方法构建包含稳态控制器、过渡态控制器以及极限保护器的涡扇发动机闭环控制系统仿真平台,并对其进行仿真测试和硬件在回路实验.结果表明,所构建的仿真平台满足控制系统的性能和实时性要求,具有良好的工程适用性. 相似文献
18.
19.
针对电离层周日变化特征分析了其可能对SCORE方法估算的硬件延迟稳定性的影响. 利用BJFS以及XIAM台站的GPS观测数据, 解算了位于太阳活动高年(2001年)和太阳活动低年(2009年)的卫星硬件延迟并分析了估算的硬件延迟的稳定性. 研究发现, 电离层周日变化对估算的硬件延迟稳定性具有一定影响, 但是利用不同台站所得到的卫星硬件延迟稳定性在昼夜不同时间上的解算结果存在一定差异. 电离层周日变化对利用 BJFS台站数据解算的硬件延迟稳定性日夜差异较为明显, 在太阳活动高年利用XIAM 台站数据解算的硬件延迟日夜稳定性差异不很明显, 由于XIAM台站处于电离层赤道异常峰附近, 夜间电离层变化很大, 因此对比中纬度地区, 电离层周日变化对赤道异常峰附近地区硬件延迟稳定性解算结果的影响相对较小, 但在太阳活动低年, 其影响仍较为显著. 相似文献
20.
Nios Ⅱ处理器是Altera公司推出的基于SOPC系统的嵌入式软核处理器。在Quartus Ⅱ软件的SOPC Builder工具中,用户可以利用Nios Ⅱ处理器、标准配套外围设备以及用户自定义的逻辑接口IP核来创建适用的Nios Ⅱ嵌入式系统,再将设计下载到Altera公司的FPGA中进行实现。本文在Quartus Ⅱ软件中使用Verilog硬件描述语言创建了基于Avalon总线的ISA总线接口逻辑,并在SOPC Builder中实现对此元件的封装,使之成为可供Nios Ⅱ系统使用IP核。 相似文献