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11.
将空间网络作为一种典型的容迟/容断网络(Delay/Disruption Tolerant Network,DTN),同时利用空间网络星座拓扑的规律性和可预见性,通过构造链路通断时间图,快速建立虚拟拓扑路由表;针对路由过程中可能出现的链路中断问题,设计了拥塞控制机制、正常中断机制和链路失效机制来提高路由效率;在The ONE网络仿真平台中对提出的时间图路由算法(Time-GraphRouter)进行了仿真,并与传染路由(EpidemicRouter)、转发等待路由(SprayAndWaitRout-er)、预测路由(ProphetRouter)三种路由机制进行了对比。仿真结果表明,文章提出的路由算法的平均投递率达到了0.98以上,综合性能优于其他三种路由算法。  相似文献   
12.
飞控系统执行器模糊故障的鲁棒容错控制   总被引:1,自引:0,他引:1  
以某型飞机为研究对象,对同时含有参数不确定性和执行器带有模糊故障的飞控系统,利用Riccati方程,融完整性,鲁棒性于一体,给出了状态反馈容错控制器的设计方法。并把此方法应用一某飞机纵向飞行容错控制中,仿真结果证了方法的有效性,为飞控系统的容错控制提供了一种有效的方法。  相似文献   
13.
对于小行星绕飞任务的探测器姿态控制问题,已有方法大都考虑了干扰力矩和参数不确定等因素,而忽视了执行器故障情况。针对执行器故障条件下的小行星探测器姿态控制问题,提出了一种基于自适应迭代学习的容错控制方法。所设计的控制器包括两部分:其一针对执行器故障,设计了自适应迭代学习控制器,采用类滑模的思想和自适应迭代学习算法对控制器参数进行调整,进而补偿执行器故障带来的影响,保证系统在控制输出不足情况下的高精度姿态稳定性;其二针对探测器参量变化、外部环境干扰等不确定情况,设计了基于自适应神经网络的迭代学习控制器,采用径向基函数(RadialBasisFunction,RBF)神经网络对系统非线性部分进行逼近,同时对控制器参数进行自适应迭代学习调整,进而保证系统在不确定情况下的动态性能。数值仿真结果表明该控制器能够有效抑制外部环境干扰和内部参数变化带来的不利影响,在执行器部分失效甚至完全失效故障情况下,仍能保证系统的鲁棒性并实现误差在10-2数量级内的较高姿态控制精度。  相似文献   
14.
分析了模块级可降级重组双机系统的有效组态数,并与双机系统级备份进行了比较。分析结果表明,随着冗余级别的降低,系统的可靠性有所改善,但系统的有效组态数将大大增加,这将导致系统管理程序的复杂化。文章介绍了该系统管理程序的设计准则,并对其中几个有特点的子程序作了简要说明。  相似文献   
15.
执行器故障下的运载火箭非奇异终端滑模容错控制   总被引:2,自引:0,他引:2  
马艳如  王青  胡昌华  周志杰  梁小辉 《宇航学报》2020,41(12):1553-1560
针对存在未知外部干扰和执行器卡死故障的运载火箭,提出了一种基于非奇异终端滑模面的姿态跟踪控制算法。首先,建立了考虑干扰和执行器卡死故障的运载火箭姿态控制系统多输入多输出系统模型;然后定义了运载火箭姿态跟踪系统模型,针对定义的模型,设计了一种非奇异终端滑模面,使得系统在执行器故障情况下仍能较为精确地跟踪参考信号。基于李雅普诺夫函数证明了运载火箭姿态跟踪控制系统的稳定性和有限时间收敛特性。数值仿真检验了本文基于非奇异终端滑模运载火箭姿态跟踪控制算法的有效性。  相似文献   
16.
基于神经元的容错组合导航系统设计   总被引:6,自引:0,他引:6  
马昕  袁信 《宇航学报》1999,20(2):7-13
本文讨论了容错组合导航系统中的多传感器信息融合问题,提出了一种用于多传感器组合导航系统信息融合的神经元方法。通过仿真实验,验证了这种方法的可行性,并分析了该研究领域所存在的问题,提出了可能解决的技术途径,并预测了未来的发展趋势。  相似文献   
17.
 研究了含有参数故障的线性系统,提出了一种基于线性二次型的控制策略。采用该渐近调节反馈控制律,可以减小系统由于容错控制算法时延所致的性能下降。针对某飞机模型进行了仿真,结果验证了所提出策略的有效性。  相似文献   
18.
基于Riccati方程的离散容错控制系统设计   总被引:2,自引:0,他引:2  
基于离散系统的Riccati方程,提出一种对传感器失效具有完整性的离散控制系统的设计方法,给出了完整性设计方法的设计步骤,并用设计实例验证了该方法的有效性.该方法还可推广用于执行器失效的情况.  相似文献   
19.
本文基于H^∝最估理论和矩阵奇异值分解技术,对卫星轨道保持系统进行了分攻容错控制,提出了容许执行机构故障和传感器故障的两种分散控制律设计方法,可使卫星控制系统具有明显的容错能力。  相似文献   
20.
介绍航天容错计算机(CPU)容错的一种硬件设计方案。这种方案采用四台CPU的冗余来实现CPU的自检测,以达到CPU容错的目的。  相似文献   
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