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121.
信道估计是无线通信系统的关键技术之一。文章提出一种基于压缩感知(Compressed Sensing)的信道估计方法,这种方法通过分析信道时延和多普勒域的稀疏度,可以有效降低导频的数量,从而提高系统的频谱利用率。通过与最小均方(Least Square,LS)信道估计方法的对比,可以明显看到导频数量的降低。 相似文献
122.
文章针对众多性能优良的超分辨DOA(Direction—Of-Arrival)估计算法大都是以预知信源数为前提、信源数估计不准可能会导致DOA估计失败这一问题,提出了一种基于协方差矩阵对角加载的超分辨DOA估计算法。该算法不需要预判信源个数和进行特征值分解,且通过对协方差矩阵进行对角加载,可以平滑小快拍数时噪声特征值分散程度,因此,该算法更适用于快拍数较少的情况。理论分析表明:该算法的统计估计性能接近于MUSIC(Multiple Signal Classification)算法。计算机仿真结果验证了该算法的鲁棒性和可行性。 相似文献
123.
124.
多操纵面飞翼构型飞机舵面故障在线诊断方法 总被引:2,自引:0,他引:2
舵面故障会影响飞机的操纵性,为实现飞机的控制重构需在线诊断出舵面的故障信息.针对多操纵面飞翼构型飞机,提出了一种在线诊断其舵面故障的方法.飞翼构型飞机舵面故障在线诊断需辨识的操纵导数个数较多,直接使用最小二乘法难以精确辨识得到各操纵导数.基于限定记忆最小二乘法,采用分组辨识法对飞机的操纵导数进行辨识,减少了每次辨识操纵... 相似文献
125.
信噪比(SNR,Signalto Noise Ratio)是衡量通信系统性能的重要指标。针对传统信噪比估计算法要求利用训练序列或一帧数据范周内信道系数恒定等问题,提出了一种8PSK信号在信道系数服从高斯分布的衰落信道下肯信噪比估计算法。该算法取接收信号实部或虚部数值运算构成中间观测量,理论分析8PSK信号经过衰落信道后... 相似文献
126.
Chikako Takahashi Makoto Suzuki Chihiro Mitsuda Satoshi Ochiai Naohiro Manago Hiroo Hayashi Yoshitaka Iwata Koji Imai Takuki Sano Masahiro Takayanagi Masato Shiotani 《Advances in Space Research (includes Cospar's Information Bulletin, Space Research Today)》2011
We estimate the capability of ozone (O3) retrieval with the Superconducting Submillimeter-Wave Limb-Emission Sounder (SMILES) instrument attached to the Exposed Facility of the Japanese Experiment Module (JEM) on the International Space Station (ISS). SMILES carries a 4-K mechanical refrigerator to cool superconducting devices in space. Since SMILES has high sensitivity thanks to the superconducting receiver, it is expected that SMILES has ability to retrieve O3 profiles more precisely than the previous millimeter–submillimeter limb measurements from satellites. 相似文献
127.
128.
129.
INS/SAR组合导航参数传递建模及精度分析 总被引:1,自引:0,他引:1
对合成孔径雷达景象匹配辅助(INS/SAR)组合导航中地面合成孔径雷达(SAR)匹配点位置参数向飞行器主惯导中心的传递过程进行研究。分析了SAR匹配点位置传递过程中所涉及的各环节及其相互关系,以此为基础建立了测量参数传递过程数学模型,提出适合该模型的误差分析与精度估计方法,结合理论和实验结果对各测量参数误差所造成的传递误差进行分析和比较,得出单一测量参数误差影响程度的排序,并在此基础上得出总精度的估计值。参数传递模型及精度实验结果与实际情况相符,可为组合导航中合理的精度分配提供依据。 相似文献
130.
针对可变尺寸块运动估计(VBSME,Variable Block-Size Motion Estimation)的硬件结构在现场可编程门阵列(FPGA, Field Programmable Gate Array)上实现时消耗资源多且速度慢的问题,提出了一种面积和速度优化的VBSME硬件结构.其中,绝对差累加和(SAD,Sum of Absolute Differences)的计算采用基于随机存储器(RAM,Random Access Memory)的累加计算方式,比基于寄存器合并的方式节省了面积并增加了速度;通过采用脉动比较链而非总线结构,增强了多个SAD值的比较能力,并能高效地实现对部分差排除算法(PDE,Partial Difference Elimination)的支持.基于Virtex-II型FPGA器件,本结构消耗了2261个slice,时钟频率达到164MHz,在搜索窗口为16×16时可实时处理标清格式的视频.与同类设计相比,设计的面积可减少77%,速度增加218%,FPGA的硬件效率显著提升. 相似文献