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701.
论述了雷达信号侦察系统的自检原理及过程。研究指出,侦收-处理系统的状态变化会对自检信号参数产生影响,信号通过系统的跨越门限会影响侦收信号概率。同时,通过自检可以估测系统当前的性能,采用时域或频域自检方法可测定自检信号的基本参数。 相似文献
702.
研究JPEG2000标准中EBCOT扫描的FPGA实现问题,提出基于组的像素点跳跃和编码块并行两种方案混合使用的EBCOT位平面扫描方案。该设计使用VHDL编写,目标器件为A LTERA STRATIX系列的EP1S25F672C6,模块稳定运行在120MHZ。对于每个并行扫描分路来说,每个时钟周期平均可以产生0.95个上下文信息。分析表明,该设计在图像实时压缩的场合具有优势。 相似文献
703.
704.
采用有限域上多项式的乘法规则设计了一种通用乘法运算模块;以乘法模块为基础,实现了一种RS编译码软件解决方案。该方案可以适应GF(2n)域(n≤8)上不同域本原多项式、不同纠错能力的RS码,具有很强的通用性。所设计的通用RS编译码软件为算法开发、验证和硬件设计调试提供了一种有力的辅助手段。 相似文献
705.
706.
707.
利用组合码进行纠错的检错重传方案 总被引:1,自引:0,他引:1
将一个码字重复J次得到的一个新码字是原码字的组合码。只要信道(假定为二进制对称信道)的比特差错率小于0.5,组合码的抗干扰能力就大于原码,且该能力随着J值的增大而增大。在检错重传通信系统中,利用多次重传得到的多个有错码字,按某种规则对它们进行组合译码可望译得正确码字。从而可提高信息利用率,减少重传次数。本方案对于某些信道特性不稳定的遥测遥控或其它通信系统具特殊意义。本文推导组合码的实用译码算法及译码失误率的估算公式,具体给出了使译码失误率小于给定值、利用组合码进行纠错的检错重传方案的算法框图。 相似文献
708.
709.
讨论JPEG2000标准中算术编码器的硬件实现问题,提出一种适合静止图像实时处理的FPGA设计,并对其作仿真验证。该设计使用VHDL语言进行描述,并以X ilinx VertexⅡ系列中的xc2v250-6 fg256器件为基础,在ise6.1完成综合,用Modelsim5.7进行后仿真。综合器件最高工作时钟103MHz。分析表明,该设计能满足JPEG2000框架下灰度图静态压缩的实时处理要求。 相似文献
710.