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基于小波变换和优化截取内嵌块编码算法(EBCOT)的JPEG2000是目前最好的静止图像压缩编码标准,但其中的MQ编码限制了其在高速处理中的应用。文章提出了一种MQ编码器的硬件设计结构。该算法采用了流水线结构设计,通过模块并行,极大地提高了系统效率,较好地解决了同一时钟产生2个字节码流输出的问题,并且FLUSH模块的时序控制问题也得到了解决。仿真结果表明,该方案不仅效率高,而且占用逻辑资源少. 相似文献
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JPEG2000中一种EBCOT并行体系的研究 总被引:1,自引:0,他引:1
EBCOT是JPEG2000系统中占运算时间最多的一部分。为了提高JPEG2000的编码效率,文章提出了一种基于编码通道独立和条带独立的并行EBCOT编码体系。通过一次扫描,实现3个编码通道的并行编码,每个编码通道调用一组MQ编码器。同时,选择“条带一因果”模式消除条带间的关联性。这样,3个通道就可以并行编码而不互相干扰,大大提高了编码速度。每个编码通道结束时终止MQ编码器,错误不会传递到其他编码通道,增强了容错性。实验表明,此方法在保持JPEG2000优异性能的基础上,提高了JPEG2000的编码效率。 相似文献
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利用TMS320F2812的正交编码电路及HEDSS的增量式编码器测异步电机转速,介绍了测速原理,提供了调试成功的C源程序,采用两种方法验证测得的异步电机转速,给出了该方法在实际应用中的注意事项。 相似文献
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面向高分辨率对地观测卫星的高速数传应用需求,提出了一种低实现复杂度、多码率融合的LDPC并行编码结构,以及采用该结构的编码器芯片设计方案。基于TSMC 130 nm CMOS标准单元库,该编码器芯片在200 MHz时钟下能够达到1.6 Gbps的吞吐率,硅片面积为5.495 mm 2,功耗仅为184.3 mW。与传统结构设计的相同吞吐率的LDPC编码器芯片相比,本文方案可以将存储空间需求降至传统结构的18.52%,硅片面积和功耗分别下降至传统结构的20.3%和83.3%,非常适用于超高速星上通信应用。 相似文献
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Websphere MQ是IBM的商业通讯中间件(Commercial Messaging Middleware)。Websphere MQ提供一个具有工业标准、安全、可靠的消息传输系统。它的功能是控制和管理一个集成的商业应用,使得组成这个商业应用的多个分支程序(模块)之间通过传递消息完成整个工作流程。 相似文献
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文章介绍了CBERS-1卫星上的重要设备之一-红外编码器的技术原理和实施效果。红外编码器完成了4个谱段图像数据和北极太阳定标数据的采集过程控制、模/数转换、接收OBDH送来的工程参数、产生的相对计数相同、复杂编码以及数据在不同工作模式下进行高速传输等工作,它是采用计算机方案设计实现操作的。 相似文献
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重点讨论卫生遥感图象的高速实时ADPCM压缩编码。首先,我们提出了一种自适应预测器,并对其简化算法进行了计算机模拟。模拟结果表明,由于自适应预测,信噪比可获得0.09-2.7dB的提高。同时也给出了3bit/pexl的编码器硬件实现。 相似文献
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本文介绍了一种适合两种旋转编码器、两开关量动作8路输出的电子式凸轮开关的设计方案.该控制器根据机械凸轮原理设计,以双单片结构为控制中心,对从旋转编码器输入其中的脉冲或编码进行数据采集和处理,将处理结果以开关电平的方式输出.该控制器可作为独立通用的控制单元与其它可编程控制器组合使用,使应用系统的开发工作量显著降低,适用于具有循环往复、顺序动作特点的机电一体化设备中. 相似文献
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本文介绍了一种适合两种旋转编码器、两开关量动作8路输出的电子式凸轮开关的设计方案。该控制器根据机械凸轮原理设计,以双单片结构为控制中心,对从旋转编码器输入其中的脉冲或编码进行数据采集和处理,将处理结果以开关电平的方式输出。该控制器可作为独立通用的控制单元与其它可编程控制器组合使用,使应用系统的开发工作量显著降低,适用于具有循环往复、顺序动作特点的机电一体化设备中。 相似文献
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文章介绍了CBERS_1卫星上的重要设备之一———红外编码器的技术原理和实施效果。红外编码器完成了4个谱段图像数据和北极太阳定标数据的采集过程控制、模/数转换、接收OBDH送来的工程参数、产生的相对计数时间、复杂编码以及数据在不同工作模式下进行高速传输等工作 ,它是采用计算机方案设计实现操作的。 相似文献
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引言
随着计算机网络和分布式应用的不断发展,远程消息传递越来越成为应用系统中不可缺少的组成部分。商业消息中间件的出现保证了消息传输的可靠性,高效率和安全性,同时也减少了系统的开发周期。目前应用最多的消息中间件产品为IBM MQSeries。要保证MQ消息24小时不间断发送的关键是依靠信息技术的可用性。HACMP for AIX软件能够保证关键性资源的高可用性。 相似文献
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讨论JPEG2000标准中算术编码器的硬件实现问题,提出一种适合静止图像实时处理的FPGA设计,并对其作仿真验证。该设计使用VHDL语言进行描述,并以X ilinx VertexⅡ系列中的xc2v250-6 fg256器件为基础,在ise6.1完成综合,用Modelsim5.7进行后仿真。综合器件最高工作时钟103MHz。分析表明,该设计能满足JPEG2000框架下灰度图静态压缩的实时处理要求。 相似文献