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针对数字组合逻辑电路电路故障修复问题,采用遗传算法与可重构器件FPGA相结合的方法设计自演化硬件系统。利用 Xilinx公司 XUPV5-110T FPGA开发板作为硬件平台,搭建虚拟重构电路,并利用软核处理器实现算法。系统进化单元为虚拟重构电路,由遗传算法自动控制生成具体功能电路。实验通过全加器和4位奇偶校验器,验证了硬件电路的自演化。 相似文献
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SRAM型FPGA内嵌CPU软核开发成本低、开发过程灵活,可以替代独立的DSP或CPU器件,执行星载设备核心控制功能。但这种内嵌CPU软核容易受到空间单粒子翻转效应(SEU)的影响。SEU可能导致内嵌CPU软核的硬件或软件故障,对其在轨应用影响较大。提出一种针对SRAM型FPGA内嵌CPU软核的SEU防护方案,通过"三模冗余+动态刷新"对CPU软核的硬件结构进行防护,通过冗余自刷新模块替换对CPU软核的存储区进行防护。该方案经过了软件注错验证及粒子辐照试验验证,证明其能够有效提高SRAM型FPGA内嵌CPU软核对SEU的容错能力。 相似文献
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介绍了基于ALTERA公司FPGA器件的高速实时FFT运算单元实现及频率域脉冲压缩处理的设计方法.在分析了基8、按频率抽取FFT算法的基础上,采用多级同步流水线结构,利用现场可编程门阵列(FPGA)完成了最大4096点块浮点FFT.整个设计划分成多个功能模块,采用VHDL描述语言,并在Stratix器件上实现.结果表明,利用FPGA实现复杂的数字信号处理(DSP)算法是完全可行的. 相似文献
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文章采用VHDL语言与原理图输入相结合的方法,运用ALTERA公司STRATIX系列FPGA器件,实现了Rader正交变换算法,并用QuartusⅡ和Matlab软件对设计进行了联合仿真,然后将设计下载到FPGA开发板上进行了硬件验证。 相似文献
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针对现代雷达系统功能需求多样化、处理数据量大的特点,提出一种基于现场可编程门阵列(FPGA)处理平台的多模式高效频域脉冲压缩方法。其快速傅里叶变换(FFT)模块采用复式FFT结构,其运算能力比基-4 Burst I/O结构提高了一倍;参考函数模块采用实时查表法,根据发射信号基本参数对参考信号进行实时生成;脉冲压缩模块进行了知识产权(IP)核封装处理,使其既能通过灵活配置适应多工作模式实用需求,又能够便利地移植和复用。采用此方法在基于Virtex-7 FPGA硬件平台上进行试验验证,结果表明,该方法能够高效地实现8192点至32768点脉冲压缩处理,处理点数多,实时性高,且处理结果满足航天工程应用要求。 相似文献
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根据SpaceWire总线的组成结构以及采用的数据-滤波编解码技术,针对SpaceWire节点需要与主机设备、SpaceWire接口设备进行异步交互的特点,文章给出了一种SpaceWire节点的高效实现方案。首先,该方案在硬件设计中采用了SpaceWire节点的多时钟域设计,使得节点整体性能得以显著提升;第二,采用双倍数据速率寄存器设计来降低SpaceWire节点发送端设计难度,解决了高速数据发送问题;第三,采用手动布局接收端的底层器件来满足时序要求,解决了高速数据接收问题;第四,计算出接收端RX FIFO的理论读出时钟频率指导硬件程序设计。在此基础上,采用SpaceWire节点的点对点数据传输实验对文章设计验证,结果表明文章给出的方案可以工作在240MHz时钟频率下,满足空间高速数据传输中高可靠性、低误码率和低复杂度的要求。 相似文献
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针对航天高速SpaceWire总线系统对协议IP的高可靠性要求,提出一种用于静态随机访问存储器(SRAM)型现场可编辑逻辑门阵列(FPGA)的增强三模冗余(TMR)方法。该方法对传统三模冗余和部分三模冗余做了改进,将需要进行三模冗余的原设计分为一般单元集和可靠性薄弱的关键单元集,对一般单元集中的每个单元做三模冗余,对关键单元集中的每个单元做顺序四模冗余。给出了顺序四模冗余的可靠度计算式和表决器的布尔表达式。建立了系统可靠性的马尔科夫模型并基于模型开展了可靠性仿真。仿真结果表明增强三模冗余系统的可靠性不仅明显优于传统三模冗余系统,而且优于部分三模冗余系统,使系统可靠性得到有效提高。 相似文献
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SpaceWire星载网络通信协议设计 总被引:4,自引:0,他引:4
SpaceWire是ESA和NASA推荐的新一代星载数据总线标准,其应用方向之一是构建统一总线星载网络。星载网络是典型的实时系统,它对网络信息的传输时延具有严格要求。然而,传统SpaceWire网络多源、异步、事件触发的特性使它难以提供确定的信息传输时延,这制约了它在统一总线星载网络中的应用。本文为克服SpaceWire的上述应用瓶颈,提出一种基于时间触发的SpaceWire星载网络通信协议,并提出相应的节点通信调度算法,通过合理的规划使节点在确定的时间窗口发送通信数据,从而避免了网络资源冲突,使信息传输时延的确定性得到保证。 相似文献
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A novel autonomous low-cost on-board data handling architecture for a pin-point planetary lander 总被引:1,自引:0,他引:1
Tanya Vladimirova Muhammad Fayyaz Martin N. Sweeting Valentin I. Vitanov 《Acta Astronautica》2011,68(7-8):811-829
There has been increased interest in the exploration of the Moon in recent years. Pin-point precision landing is highly desirable for future lunar missions. This paper is concerned with the design of the on-board data handling (OBDH) subsystem for the pin-point lunar lander of the Magnolia-1 project, funded by NASA. Four proposed on-board data handling architectures are outlined and compared in terms of power consumption, performance and reliability. Implementation results are presented, which are obtained from prototyping of the flight computer for the optimal OBDH architecture option on a Xilinx Virtex-5 Field Programmable Gate Array. 相似文献