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比特并行Reed—Solomon编码器的设计 总被引:4,自引:1,他引:3
研究高速RS码编码器设计问题。给出了最优对偶基的计算方法,研究了用对偶基下的bit-parallel乘法器构成RS码系统码编码器。编码器可以达到较高的吞吐率。 相似文献
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论文介绍了DVB标准的RS码的编译码的设计和实现,针对有限域乘法的代数特点,提出了一种新的有限域乘法器结构,大大降低了编译码电路的复杂度。在传统的译码器基础上,设计了新的译码器结构,并用Verilog语言实现了编译码器的各个模块功能,在现场可编程门阵列(FPGA)芯片上实现和验证了该设计结构。 相似文献
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讨论了开关电容乘法器的设计,其中着重讨论了寄生电容不敏感型开关电容四象限模拟乘法器的设计,并提出了一种新型的电路结构,分析了它的性能,同时还研究了元器件的非理想特性对其性能的影响以及采用的补偿方法。 相似文献
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