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方位降采样滤波器设计和FPGA实现   总被引:4,自引:0,他引:4  
在SAR(合成孔径雷达)雷达实时信号处理中,为了降低运算量且不影响成象质量,通常需要对输入的距离-方向二维数据在方位上做降采样和滤波处理。为了满足实时处理的需要,本文提出了一种将降采样和方位滤波相结合的设计,以及利用窗函数设计滤波器系数的方法,运用硬件描述语言Verilog HDL构造了一种用现场可编程门阵列FPGA实现降采样滤波器的电路结构,并分析了其性能。该降采样滤波器的降采样率和滤波器阶数可变,可适应多种场合的需要。  相似文献   
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