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1.
提出一种基于FPGA的600Mb/s高速数传接收机全数字实现方案,对采用Costas环的载波恢复算法和采用并行数据转换跟踪环的码同步算法作了介绍。测试结果表明,该接收机在码速率小于350Mb/s时,解调损失小于1.5dB;在码速率为600Mb/s时,解调损失小于3dB。  相似文献   
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