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通过对直接数字频率合成(DOS)和锁相环(PLL)相结合实现频率合成的几种方式进行综述,提出一种适合卫星通信的快速跳频频率合成方案。 相似文献
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简单介绍频率合成技术.对用于半主动导引头的频率合成器直波锁相环方案进行了优化选择.特别对导引头处于“外相参”条件下的锁相状态,及其如何与倒置接收机实现接口,提出了一种在工程上可以实现的最佳方案. 相似文献
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论文针对传统的锁相环(PLL)频率合成方式和直接数字合成(DDS)方式的各自结构原理与优点来进行比较,指出他们的主要难点是在应用中实现宽频带、高分辩率及快速换频的性能,从而提出一种新型的宽频带、换频快、分辨力高的DDS与PLL相结合(DDS&PLL)的频率合成方案,它能在2~30MHz的频率范围内以不大于2ms的时间实现最小间隔为10Hz的换频. 相似文献
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介绍实际应用中使用集成锁相频率合成芯片MB1504构成频率合成器的设计原理和应用方法,以实现小型化,低成本,低功耗,高品质的频率综合器。 相似文献
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将FPGA技术与DSP技术相互结合,简要阐述了一种新的、简洁的低重复脉冲载波频率测试的方案.通过搭建开发平剖,验证了方案的有效性和可行性。为国内在低重复脉冲载波频率测试的研制提供借鉴. 相似文献
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直接数字频率合成(DDS)技术,被广泛应用于现代电子系统及设备的频率源设计中.将DDS设计下载到FPGA中,将使系统更为可靠.应用中如何利用有限的FPGA硬件资源,得到高速、高质的DDS是经常要面对的问题.在直接数字频率合成(DDS)设计中利用波形压缩节省FPGA资源.硬件测试证明,该方法可行并完全达到设计要求. 相似文献
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DDS中实现波形压缩的一种方法 总被引:1,自引:0,他引:1
直接数字频率合成(DDS)技术,被广泛应用于现代电子系统及设备的频率源设计中。将DDS设计下载到FPGA中,将使系统更为可靠。应用中如何利用有限的FPGA硬件资源,得到高速、高质的DDS是经常要面对的问题。在直接数字频率合成(DDS)设计中利用波形压缩节省FPGA资源。硬件测试证明,该方法可行并完全达到设计要求。 相似文献
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捷变频雷达导引头射频环境仿真及其关键技术 总被引:2,自引:0,他引:2
介绍了捷变频雷达导引头的信号特征和对捷变频雷达射频环境仿真的基本方法。着重讨论了瞬时测频仿真方案和射频延迟线仿真方案的工程实现和关键技术 ,指出改进频率校准方法提高频率引导精度是瞬时测频仿真方案的关键技术 ;发展低损耗、宽频带、延迟时间连续可调的高性能射频延迟线是射频延迟线仿真方案的关键技术。对两种仿真方案的特点进行了比较。 相似文献
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现代雷达电子对抗广泛使用DRFM 对雷达信号进行采样、存储与处理。传统频率合成技术无法同时满足高性能DRFM 对频率信号的稳定、低杂散、多路相参等指标要求。研究了频率源输出信号的抖动与杂散谐波对采样系统杂散性能的影响,结合传统频率合成技术,设计了基于FPGA和低噪声时钟抖动消除器的频率源电路,并对初级信号的谐波抑制设计了基于带通滤波器和微带滤波器的窄带滤波电路。最后,对系统的测试结果表明,本设计可输出多路频率范围为2.27~2600M Hz(分段)的频率信号,步进小于10kHz。信号相位噪声优于-95dBc/Hz @100kHz ,杂散抑制优于-60dBc。 相似文献
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文章首先讨论了宽带快速频率合成技术的特点,然后在此基础上分析了其对通信性能的影响,并结合实际情况给出了具体建议。 相似文献
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为解决用于直接模拟式频率综合器、锁相式频率综合器跳频时间测试方法的不足,提出了一种用调频控制器、合成信号源混频器和示波器等进行测试的改进方法。给出了测试原理和条件。分析和应用结果表明,该方法基本适用于不同的频率综合器,且不影响综合器的正常工作,能真实反映其调频时的工作状态。 相似文献
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本文提出了以高频锁相环集成电路和I波段压控振荡器为核心的小型化频率合成方法,介绍了试验情况,给出了试验结果。该方法实现了小体积、低功耗和低元件数量,具有一定的前瞻性和使用价值。 相似文献